机译:维特比解码器的位级流水线数字串行VLSI架构的设计和FPGA实现
机译:使用准延迟不敏感模板实现的维特比解码器的异步低功耗和高性能VLSI架构
机译:硬决策维特比解码算法的可配置和低复杂度设计的VLSI架构
机译:用于片上系统设计的稳健VLSI架构及其在Viterbi解码器中的实现
机译:2/3维特比解码器的VLSI实现和数字IC中的噪声影响。
机译:DCRAM架构的排序过滤的VLSI设计研究
机译:用于硬判决维特比译码算法的可配置低复杂度设计的VLsI结构
机译:用于霍夫曼和维特比解码器的高速VLsI架构。 (重新公布新的可用性信息)